FE2.1是一個高度集成，高質(zhì)量，高性能，低功耗，低成本的解決方案的整體系統(tǒng)的USB 2高速集線器。

它采用多事務翻譯（MTT）架構(gòu)，探索最大可能的吞吐量。六，而不是兩個，非周期的事務緩沖區(qū)，以盡量減少潛在的交通干擾。整個設計是基于狀態(tài)機控制，以減少響應延遲時間，沒有微控制器在該芯片中使用。

為了保證高質(zhì)量，整個芯片被測試的掃描鏈–甚至包括高速（480mhz）模塊，這樣所有的邏輯組件可以在發(fā)貨前進行充分的測試。特殊的內(nèi)建自測試模式的設計運動都高，滿，低速模擬前端（AFE）在封測階段以及組件。

采用0.18μm技術和綜合功率/時鐘控制機制實現(xiàn)低功耗。

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FE2.1的框架圖：

FE2.1的引腳分布：

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